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>>362
imecは、3nmまではNanosheet、2nmはForksheet、1nmはCFETというロードマップに組織内の共通認識を統一した模様である。というのは、今回のVLSIシンポジウムで、imecの他の発表者、例えば、Sujith Subramanian氏も、上記のロードマップに準拠した発表を行っていたからである
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>>362
imecは、3nmまではNanosheet、2nmはForksheet、1nmはCFETというロードマップに組織内の共通認識を統一した模様である。というのは、今回のVLSIシンポジウムで、imecの他の発表者、例えば、Sujith Subramanian氏も、上記のロードマップに準拠した発表を行っていたからである
>>360
MOKさんが以前指摘していた様に、潜在不良をどう落とすかを考えると、大規模LSIのトランジスタ構造にシリコン単結晶もしくはSiGe単結晶以外のチャンネルを使うのは難しそうですしね。